P á g i n a | viii
3.3.5.4.6.1 Habilitación interrupción Rx (Enable Rx interrupt)...............................34
3.3.5.4.6.2 Habilitación interrupción de sistema (Enable system interrupt).........34
3.3.5.4.7 Interfaz de comunicación serie (SCI)........................................................35
3.3.5.4.7.1 Tasa de baudios (Baud rate)...................................................................35
3.3.5.4.7.2 Modo de bloqueo (Blocking mode).........................................................35
3.3.5.4.7.3 Longitud de carácter en bits (Character length bits)............................36
3.3.5.4.7.4 Modo de comunicación (Communication mode)..................................36
3.3.5.4.7.5 Orden de los datos en bytes (Data byte order). ...................................36
3.3.5.4.7.6 Cantidad de datos en transmisión (Data swap width)......................... 36
3.3.5.4.7.7 Habilitación bucle de regreso (Enable Loopback). .............................. 37
3.3.5.4.7.8 Número de bit de parada (Number of stop bits)...................................37
3.3.5.4.7.9 Modo paridad (Parity mode).................................................................... 37
3.3.5.4.8 Modo de suspensión..................................................................................... 38
3.3.5.4.8.1 Asignación de pines Rx (Pin assignment Rx).......................................38
3.3.5.4.8.2 Asignación de pines Rx (Pin assignment Tx). ...................................... 38
3.3.5.4.9 Interfaz de periféricos serie (SPI). ..............................................................39
3.3.5.4.9.1 Factor de tasa de baudios (Baud rate factor). ...................................... 39
3.3.5.4.9.2 Fase de reloj (Clock phase)..................................................................... 39
3.3.5.4.9.3 Polaridad de reloj (Clock polarity)...........................................................40
3.3.5.4.9.4 Modo de suspensión (Suspension mode).............................................40
3.3.5.4.9.5 Bits de datos (Data bits)........................................................................... 40
3.3.5.4.9.6 Habilitación bucle de regreso (Enable Loopback). .............................. 40
3.3.5.4.9.7 Habilitación modo tres cables (Enable 3–wire mode). ........................40
3.3.5.4.9.8 Habilitación FIFO (Enable FIFO). ...........................................................41
3.3.5.4.9.9 Nivel de interrupción FIFO Rx (FIFO interrupt level (Rx)). .................41
3.3.5.5 Nivel de interrupción FIFO Tx (FIFO interrupt level (Tx)). ......................41
3.2.5.5.1 Retardo de transmisión FIFO (FIFO transmit delay). ..............................41
3.3.5.5.2 Modo................................................................................................................41
3.3.5.5.3 Asignación pin CLK.......................................................................................41
3.3.5.5.4 Asignación pin SOMI. ...................................................................................41
3.3.5.5.5 Asignación de pin STE (Pin de habilitación para transmisión en modo
esclavo).
.......................................................................................................................... 42
3.3.5.5.6 Asignación pin SIMO. ...................................................................................42
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